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D17133CS Datasheet

  • D17133CS

  • 4-BIT SINGLE-CHIP MICROCONTROLLER

  • 289頁

  • NEC   NEC

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CHAPTER 1
GENERAL
1.3 BLOCK DIAGRAM
鈥?Block diagram of the
碌
PD17120 and 17121
V
DD
Power On/
Power-Down
Reset
Clock
Divider
f
X
/2
N
System Clock
Generator
CPU CLK CLK STOP
X
IN
X
OUT
P0A
0
P0A
1
P0A
2
P0A
3
RF
P0A
(CMOS)
RAM
64
脳
4 bits
SYSTEM REG.
Interrupt
Controller
IRQTM
ALU
Timer
f
X
/2
N
INT
IRQTM
IRQSIO
P0B
0
P0B
1
P0B
2
P0B
3
P0B
(CMOS)
P0C
0
P0C
1
P0C
2
P0C
3
P0C
(CMOS)
Instruction
Decoder
P0E
0
P0E
1
P0E
(N-ch)
ROM
768
脳
16 bits
P0D
(N-ch)
P0D
0
/SCK
P0D
1
/SO
P0D
2
/SI
P0D
3
/TMOUT
IRQSIO
Program Counter
RESET
GND
Stack 5
脳
10 bits
Serial
I/O
TM
Remark
The terms CMOS and N-ch in parentheses indicate the output form of the port.
CMOS:
N-ch:
CMOS push-pull output
N-channel open-drain output (Each pin can contain pull-up resistor as specified using a mask
option.)
4

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