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K4H1G0438M-TCA0 Datasheet

  • K4H1G0438M-TCA0

  • 128Mb DDR SDRAM

  • 53頁

  • SAMSUNG   SAMSUNG

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128Mb DDR SDRAM
8.2 AC Timming Parameters & Specifications
Parameter
Row cycle time
Refresh row cycle time
Row active time
RAS to CAS delay
Row precharge time
Row active to Row active delay
Write recovery time
Last data in to Read command
Col. address to Col. address delay
Clock cycle time
Clock high level width
Clock low level width
DQS-out access time from CK/CK
Output data access time from CK/CK
Data strobe edge to ouput data edge
Read Preamble
Read Postamble
Data out high impedence time from CK/CK
CK to valid DQS-in
DQS-in setup time
DQS-in hold time
DQS-in high level width
DQS-in low level width
DQS-in cycle time
Address and Control Input setup time
Address and Control Input hold time
Mode register set cycle time
DQ & DM setup time to DQS
DQ & DM hold time to DQS
DQ & DM input pulse width
Power down exit time
Exit self refresh to write command
CL=2.0
CL=2.5
tCH
tCL
tDQSCK
tAC
tDQSQ
tRPRE
tRPST
tHZQ
tDQSS
tWPRES
tWPREH
tDQSH
tDQSL
tDSC
tIS
tIH
tMRD
tDS
tDH
tDIPW
tPDEX
tXSW
0.45
0.45
-0.75
-0.75
-
0.9
0.4
-0.75
0.75
0
0.25
0.4
0.4
0.9
0.9
0.9
15
0.5
0.5
1.75
10
95
0.6
0.6
1.1
Symbol
tRC
tRFC
tRAS
tRCD
tRP
tRRD
tWR
tCDLR
tCCD
tCK
K4H281638B
-TCA2 (DDR266A)
Min
65
75
45
20
20
15
2
1
1
7.5
15
15
0.55
0.55
+0.75
+0.75
+0.5
1.1
0.6
+0.75
1.25
120K
Max
K4H281638B
-TCB0 (DDR266B)
Min
65
75
45
20
20
15
2
1
1
10
7.5
0.45
0.45
-0.75
-0.75
-
0.9
0.4
-0.75
0.75
0
0.25
0.4
0.4
0.9
0.9
0.9
15
0.5
0.5
1.75
10
0.6
0.6
1.1
15
15
0.55
0.55
+0.75
+0.75
+0.5
1.1
0.6
+0.75
1.25
0.45
0.45
-0.8
-0.8
-
0.9
0.4
-0.8
0.75
0
0.25
0.4
0.4
0.9
1.1
1.1
16
0.6
0.6
2
10
116
0.6
0.6
1.1
120K
Max
K4H281638B
-TCA0 (DDR200)
Min
70
80
48
20
20
15
2
1
1
10
15
15
0.55
0.55
+0.8
+0.8
+0.6
1.1
0.6
+0.8
1.25
120K
Max
ns
ns
ns
ns
ns
ns
tCK
tCK
tCK
ns
ns
tCK
tCK
ns
ns
ns
tCK
tCK
ns
tCK
ns
tCK
tCK
tCK
tCK
ns
ns
ns
ns
ns
ns
ns
ns
3
2
Unit Note
- 44 -
REV. 1.0 November. 2. 2000

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