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M12L32162A-7BG Datasheet

  • M12L32162A-7BG

  • 1M x 16Bit x 2Banks Synchronous DRAM

  • 703.30KB

  • 29頁(yè)

  • ESMT

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ESMT
Mode Register Set Cycle
0
CLOCK
1
2
3
4
5
6
Preliminary
Auto Refresh Cycle
0
1
2
3
4
5
M12L32162A
6
7
8
9
10
CKE
HIGH
HIGH
CS
*Note2
RAS
*Note1
CAS
*Note3
ADDR
Key
Ra
t
RC
DQ
Hi-Z
Hi-Z
WE
DQM
MRS
New C om m an d
Auto Ref res h
New C om m an d
:Don't Care
*Both banks precharge should be completed before Mode Register Set cycle and auto refresh cycle.
MODE REGISTER SET CYCLE
*Note: 1. CS , RAS , CAS &
WE
activation at the same clock cycle with address key will set internal mode register.
2.Minimum 2 clock cycles should be met before new RAS activation.
3.Please refer to Mode Register Set table.
Elite Semiconductor Memory Technology Inc.
Publication Date
:
Apr. 2007
Revision
:
0.3
26/29

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