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M12L32162A-7BG Datasheet

  • M12L32162A-7BG

  • 1M x 16Bit x 2Banks Synchronous DRAM

  • 29頁

  • ESMT

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ESMT
Preliminary
M12L32162A
Single Bit Read-Write-Read Cycle (Same Page) @CAS Latency=3, Burst Length=1
t
CH
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CLOCK
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*Note1
HIGH
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RC
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SH
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*Note2,3
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*Note4
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BS
BS
BS
BS
BS
A10 /AP
Ra
*Note 3
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*Note 3
*Note4
Rb
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WE
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SS
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SS
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SH
t
OH
Db
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SS
t
SH
t
SH
Qc
Row Active
Read
W rite
Read
Precharge
Row Active
:D on' t Care
Elite Semiconductor Memory Technology Inc.
Publication Date
:
Apr. 2007
Revision
:
0.3
11/29

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