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CD54HC175 Datasheet

  • CD54HC175

  • High-Speed CMOS Logic Quad D-Type Flip-Flop with Reset

  • TI

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CD54HC175, CD74HC175, CD54HCT175, CD74HCT175
Prerequisite For Switching Speci鏗乧ations
PARAMETER
Setup Time, Data to Clock
SYMBOL
t
SU
(Continued)
V
CC
(V)
2
4.5
6
Hold Time, Data to Clock
t
H
-
2
4.5
6
Removal Time, MR to Clock
t
REM
-
2
4.5
6
Clock Frequency
f
MAX
-
2
4.5
6
HCT TYPES
Clock Pulse Width
MR Pulse Width
Setup Time Data to Clock
Hold Time Data to Clock
Removal Time MR to Clock
Clock Frequency
t
w
t
w
t
SU
t
H
t
REM
f
MAX
Input t
r
, t
f
= 6ns
25
o
C
V
CC
(V)
TYP
MAX
-40
o
C TO 85
o
C
MAX
-55
o
C TO
125
o
C
MAX
UNITS
-
-
-
-
-
-
4.5
4.5
4.5
4.5
4.5
4.5
20
20
20
5
5
25
-
-
-
-
-
-
-
-
-
-
-
-
25
25
25
5
5
20
-
-
-
-
-
-
30
30
30
5
5
16
-
-
-
-
-
-
ns
ns
ns
ns
ns
MHz
25
o
C
MIN
80
16
14
5
5
5
5
5
5
6
30
35
TYP
-
-
-
-
-
-
-
-
-
-
-
-
MAX
-
-
-
-
-
-
-
-
-
-
-
-
-40
o
C TO 85
o
C -55
o
C TO 125
o
C
MIN
100
20
17
5
5
5
5
5
5
5
25
29
MAX
-
-
-
-
-
-
-
-
-
-
-
-
MIN
120
24
20
5
5
5
5
5
5
4
20
23
MAX
-
-
-
-
-
-
-
-
-
-
-
-
UNITS
ns
ns
ns
ns
ns
ns
ns
ns
ns
MHz
MHz
MHz
TEST
CONDITIONS
-
Switching Speci鏗乧ations
PARAMETER
HC TYPES
Propagation Delay, Clock to
Q or Q
SYMBOL
TEST
CONDITIONS
t
PLH
, t
PHL
C
L
= 50pF
2
4.5
6
-
-
-
14
-
-
-
14
-
-
-
-
65
175
35
30
-
175
35
30
-
75
15
13
10
-
220
44
37
-
220
44
37
-
95
19
16
10
-
265
53
45
-
265
53
45
-
110
22
19
10
-
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
pF
pF
C
L
= 15pF
Propagation Delay,
MR to Q or Q
t
PLH
, t
PHL
C
L
= 50pF
5
2
4.5
6
C
L
= 15pF
Output Transition Times
t
TLH
, t
THL
C
L
= 50pF
5
2
4.5
6
Input Capacitance
Power Dissipation
Capacitance
(Notes 3, 4)
C
IN
C
PD
-
-
-
5
5

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